摘要
超光滑樣品（Ultra-smooth Sample）是半導體晶圓、精密光學基底、微機電系統（MEMS）基底等高端制造領域的核心基材，其拋光、化學機械拋光（Chemical Mechanical Polishing, CMP）、精密研磨等制程易產生納米級隱性加工缺陷，傳統檢測手段無法精準定位工藝異常根源。本文基于工業標準化實測數據，聚焦白光干涉儀（White Light Interferometer, WLI）非接觸三維形貌檢測技術，闡述其在超光滑樣品制程異常判定、根源溯源及工藝迭代中的工程應用，所有技術方案及計量標準均溯源行業商用設備實測數據與國家規范體系。
WLI 基于低相干干涉原理，完全契合 ISO 25178、GB/T 19077 表面形貌計量標準，縱向檢測精度可達亞納米級。設備采用非接觸式檢測模式，可有效規避粗糙度Ra＜0、3 nm 級超光滑表層損傷風險，彌補了探針輪廓儀（Stylus Profiler）易劃傷工件、原子力顯微鏡（Atomic Force Microscope, AFM）視場局限、無法全域缺陷篩查的行業短板。工業產線實測表明，該設備可完整重構樣品全域三維形貌，精準量化表面均方根粗糙度（Sq）、算術平均粗糙度（Sa）、微缺陷深度、面形低頻波紋畸變等核心工藝參數。
針對超光滑樣品典型加工工藝異常，WLI 可實現形貌特征與工藝問題的精準匹配溯源：線性納米微劃痕對應拋光磨料粒徑混雜、設備主軸機械抖動問題；點狀凹坑與顆粒凸起缺陷源于拋光漿料殘渣殘留、潔凈室環境顆粒污染；周期性低頻波紋畸變由拋光壓力分布不均、工裝裝夾應力失衡導致。以半導體 CMP 拋光工序為例，針對檢測發現的局部粗糙度異常抬升問題，依托 WLI 高精度形貌數據，可精準鎖定拋光墊老化、研磨液供給不均等核心故障誘因。通過優化設備下壓壓力、主軸轉速、研磨液補液量等關鍵參數，可將樣品表面 Sa 穩定控制在 0、2 nm 區間，大幅降低產品不良率。
該檢測模式可構建形貌異常-工序參數量化數據閉環，為超光滑樣品加工的設備校準、耗材選型、潔凈環境管控提供精準數據支撐，是當前精密制造領域低成本、高效率排查制程異常、穩定產品加工一致性的主流計量方案。
晶圓表面粗糙度專項分析（核心檢測指標）
（圖示為CMP拋光后實測數據，檢測精度可達6pm（0、006nm），完全滿足晶圓超光滑表面（Ultra-Smooth Surface）檢測標準，適配半導體高端芯片晶圓精密檢測場景）
（圖示為CMP拋光后實測數據，樣品表面粗糙度（Surface Roughness, Ra）=0、96nm，可精準表征晶圓拋光后表面光滑度，為拋光工藝優化（Polishing Process Optimization）、晶圓表面質量提升提供數據支撐）
（圖示為晶圓背面表面粗糙度實測數據，Ra=0、9μm，適配晶圓背面加工質量檢測場景，可保障晶圓背面金屬化（Metallization）工藝穩定性，為后續芯片鍵合（Bonding）工序提供可靠質量基礎）
大視野3D白光干涉儀
大視野3D白光干涉儀依托核心創新技術，突破傳統半導體檢測設備局限，構建晶圓（Wafer）檢測新范式。設備可實現納米級（Nanoscale）全場景精密測量，兼具高精度與高效率優勢，全面適配晶圓加工全流程檢測需求，重塑半導體（Semiconductor）領域精密測量（Precision Measurement）行業標準，為半導體晶圓加工、封裝全流程質量管控提供權威、精準的實測數據支撐。
核心優勢：大視野+高精度，打破半導體檢測行業壁壘
設備突破傳統檢測設備性能局限，解決了傳統1倍以下物鏡（Objective Lens）僅可單孔檢測、需兩臺設備分別完成大視野觀測與高精度測量的行業痛點。本設備搭載0、6倍輕量化專用鏡頭，配置15mm超大單幅視野（Single Frame Field of View），搭配可兼容4組物鏡的轉塔鼻輪（Turret Nose Wheel），單臺設備即可兼顧大視野全域觀測與納米級高精度測量，無需頻繁切換檢測設備，顯著提升半導體量產場景下的檢測效率（Inspection Efficiency）與數據精準度（Data Accuracy），適配晶圓及配套精密部件的復雜檢測工況。
晶圓相關實測應用圖示及說明（半導體專屬）
（圖示為化學機械拋光（Chemical Mechanical Polishing, CMP）研磨碟盤表面金剛石顆粒共面度（Coplanarity）分析：左側為局部放大細節圖，右側為全域共面度分析圖，直觀呈現設備大視野3D精密測量能力，助力研磨碟盤質量管控（Quality Control），保障晶圓整體拋光均勻性）
（圖示為裸片晶圓（Bare Wafer）翹曲（BOW）、彎曲（WARP）等形變（Deformation）測量，可精準捕捉微米級晶圓形變數據，有效保障晶圓加工及封裝（Packaging）精度，規避芯片封裝過程中破損、虛焊等質量缺陷）
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